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- 电路为什么要有触发器这种结构？ - 知乎
最后说下，触发器的内容 一定要认真理解，这个是整个数字电路的基础。 你说到了同步异步，那我说下异步电路吧。异步电路不需要时钟，低功耗，速度快，但需要用大量握手信号来同步电路，设计起来很复杂，目前还是非主流，至少十年内时序同步电路仍会是主流
- 触发器 (filp-flop)和触发器 (trigger)有什么区别？ - 知乎
一、锁存器（latch）---对脉冲电平敏感，在时钟脉冲的电平作用下改变状态 锁存器是电平触发的存储单元，数据存储的动作取决于输入时钟（或者使能）信号的电平值，仅当锁存器处于使能状态时，输出才会随着数据输入发生变化。 锁存器不同于触发器，它不在锁存数据时，输出端的信号随输入
- 比较D触发器，jk触发器与基本rs触发器的触发方式有什么不同？ - 知乎
大家好，我是呼噜噜，CPU只有计算能力是不够的，还需要能够记住数据，那么电路该怎么具有记忆功能呢？ 由于 组合逻辑电路，有计算功能，但是没有记忆功能，所以引入了 触发器，揭开了 时序逻辑电路 的"神秘面纱" 触发器，也叫双稳态多谐振荡器（Bistable Multivibrator），早在1918年英国射电物理
- 主从jk触发器和边沿jk触发器的区别？ - 知乎
它们两个的逻辑表达式是相同的，即为Q*=JQ'+K'Q。对于边沿触发的，我们只需要在有效时钟沿到来的那一刻用这个表达式求出输出即可 (对于上面图片给出的边沿jk，有效时钟沿为上沿，因为clk处有没有小圆圈，表示上沿有效)。而对于脉冲触发的，我们要考虑有效时钟沿之前的半clk周期内jk的变化
- 如何理解RS触发器？在或非门构成的RS触发器中，为什么R和S都是0的时候触发器状态不变？ - 知乎
RS是由两个或非门组成，而或非门的输出又作为另一个或非门的输入。下面说一句对RS触发器理解最重要的一句话： 比如： 当R=1，S=0。我们就先看输入为1哪个，也就是R。我们知道或非门有一个输入为1，那么输出必须为0。那么，如上图，R的输出是q，R又为1，所以，Q=0（这一块应该能看懂吧！我写的
- D 触发器工作原理是什么？ - 知乎
特性：触发方式为时钟信号CLK处于 上升沿 时，更新Q的状态，使Q的逻辑与D保持一致 蓝色Q非的波形，紫色是时钟信号波形，绿色是D波形，红色是Q波形 总结：两种D触发器的触发方式不同 基础逻辑门D触发器的触发方式为CP的高电平状态 集成电路D触发器的触发方式为CLK处于上升沿（0→1跳变）
- 主从RS触发器的多次空翻现象怎么解释？ - 知乎
空翻就是指：在时钟信号CP=1的时间间隔内，输出结果Q会随着激励信号比如R和S的变化而变化。以钟控RS触发器为例，CP=0时，此时Q=0；当CP=1时，此时R=0,S=1，此时Q因为RS的值变化而从原来的0变成1，此时依然处于CP=1的时钟周期内，继续改变RS的值，让R=1,S=0，这个时候Q还是会因为RS的值变化而继续变化
- jk触发器是什么原理？谢谢。 - 知乎
长文 多图 好像图片不能直接从word复制过来，慢慢加吧~ 关注这个问题好久了，慢慢开始码字吧~ 说到JK触发器，既然是第一个回答（正式的），那就从非门说起吧。
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